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El Microcontrolador Ms Famoso de Motorola: MC68HC05P9

ARTCULO

DE

TAPA

EL MICROCONTROLADOR MAS FAMOSO DE MOTOROLA


FAMILIA

HC05

No caben dudas que los microcontroladores han invadido a los equipos electrnicos controlados. Sabemos que
los PICs se encuentran en telfonos celulares, hornos a microondas, PLCs, etc. pero tambin es cierto que es comn
encontrar en videojuegos y sistemas industriales a microcontroladores de Motorola, tales como el MC68HC05P9. Este circuito integrado, que posee ms de 10 aos, contina
siendo la vedette de muchos proyectos, a tal punto que los
primeros artculos sobre este chip, escritos en 1996 para Saber Electrnica por el Ing. Picerno, parecen haber sido la
antesala de esta explosin electrnica. En esta nota y sucesivas le brindaremos abundante informacin sobre los
microcontroladores de la familia de Motorola.
Por Egon Strauss

os microprocesadores (P)
de Motorola que se destacan
por su lnea de bajo costo y
de aplicacin mltiple, incluyen

varias opciones del modelo HC05,


entre ellos el MC68HC05P9. Obtenible con toda facilidad en nuestros mercados, permite la realizacin de muchos proyectos industriales por su versatilidad de diseo y gran variedad de opciones.
En las notas de esta serie describiremos las prestaciones de varios de estos P en total concordancia con los manuales originales de Motorola.
Ms informacin en nuestra web:
www.webelectronica.com.ar
digitando en PASS la clave: Moto170
Saber Electrnica N 170

Artculo de Tapa
1. Introduccin.
El MC68HC05P9 de Motorola es una unidad de microcontrolador (MCU) de construccin
como semiconductor de xidos
metlicos complementarios de
alta densidad (HCMOS) y forma
parte de la popular familia de
microcontroladores
tipo
M68HC05. Esta unidad de MCU
de alto rendimiento y bajo costo, constituye un sistema completo en un solo chip. Entre sus
prestaciones se destacan las siguientes:
Unidad procesadora central (CPU) del tipo M68HC05.
Registros de entrada/salida
(I/O) con direccionamiento de
memoria.
2112 bytes de memoria
ROM de usuario, incluidos 16
locaciones de vectores de
usuario.
128 bytes de memoria
RAM esttica (SRAM).
20 patitas bidireccionales
de entrada y salida (I/O) y una
patita de entrada solamente.
Port de entrada/salida (I/O)
serie sincrono (SIOP).
Operacin esttica completa (no hay velocidad mnima del
clock).
Oscilador incorporado con
conexiones para cristal o resonador cermico.
Temporizador de captura y
comparacin de 16 bits.
Modo de autorevisacin
(selfcheck).
Conversor analgico-digital
de 8 bits de cuatro canales.
Modos de STOP, WAIT y
Retencin de Datos con ahorro
de energa.
Fuente de alimentacin
nica de 3,3 a 5 Volt.
Instruccin de multiplicacin 8x8 sin firma.

Figura 1.1

Cpsula dual-in-line de 28
patitas.
Cpsula SOIC (Small Outline Integrated Circuit) de 28 patitas.

continuacin de la operacin y
cuya falta origina la interrupcin
de la operacin. Este modo permite una proteccin contra software no autorizado.

Las siguientes opciones de


mscara estn disponibles:

En la figura 1.1 vemos el esquema en bloques de la arquitectura interna de la unidad


MCU MC68HC05P9.

Disparador externo de interrupciones sensible al borde del


pulso o sensible al nivel del pulso.
Formato con el bit ms significativo (MSB) primero o con
el bit menos significativo (LSB)
primero.
Temporizador de Perro
Guardin del tipo COP (Computer Operating Properly). Como se sabe, los circuitos de proteccin COP funcionan en base
a un dgito especial introducido
en el software que permite la

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2. Conexiones.
En la figura 2.1 vemos las
conexiones de la base de la
MC68HC05P9. A continuacin
se indican las funciones correspondientes de cada una.
2.1. VDD y VSS.
Estas patitas corresponden a
las conexiones de la fuente de
alimentacin de la MCU.

El Microcontrolador Mas Famoso de Motorola: MC68HC05P9


ran sin embargo de acuerdo a
las cargas existentes en cada
patita de la MCU. -

Figura 2.1

VDD es la tensin de la
fuente y VSS es masa. Se usa
solo una nica fuente de 5 Volt
de tensin nominal.
Las transiciones de la seal
en las patitas de la MCU son de
muy alta velocidad. Estos tiempos de subida y cada tan breves, requieren de la fuente corrientes de corta duracin de
muy alto valor. Se pueden presentar tambin problemas de
ruido que deben ser suprimidos
mediante capacitores de bypass de caractersticas adecuadas. Sobre todo debe cuidarse
la respuesta en alta frecuencia
de estos capacitores y su ubicacin debe estar tan cerca de
cada patita como sea posible.
Los requisitos del bypass va-

2.2. OSC1 y OSC2.


Las patitas OSC1 y OSC2
corresponden a las conexiones
de control del oscilador incorporado. Estas patitas pueden
aceptar las siguientes alternativas:
Un cristal de acuerdo a la
figura 2.2.
Un resonador de cermica
de acuerdo a la figura 2.2.
Una seal externa de clock
de acuerdo a la figura 2.3.
La frecuencia del oscilador
fosc o de la fuente externa es
dividida por dos para producir la
frecuencia operativa fop.
2.2.1. Cristal.
El circuito de la figura 2.2
nos muestra una configuracin
tpica de oscilador para un cristal con corte AT en un circuito
resonante paralelo. Se debe
seguir las indicaciones del fabricante ya que los parmetros
del cristal determinan los valores de los componentes externos para un funcionamiento estable y un arranque confiable.
Los valores de la capacitancia
de carga usados en el diseo

del circuito oscilador deben incluir todas las capacidades distribuidas del circuito. Se debe
montar el cristal y los componentes tan cerca como sea posible a las patitas para lograr un
arranque estable y un mnimo
de distorsin en la salida.
2.2.2. Resonador de
cermica.
En aplicaciones de bajo costo puede usarse un resonador
de cermica en lugar del cristal.
Use el circuito indicado en la figura 2.2 para un resonador de
cermica y siga las recomendaciones del fabricante del resonador, debido a que los parmetros del resonador determinan el valor de los componentes externos para un funcionamiento estable y un arranque
confiable. Los valores de la capacitancia de carga usados en
el diseo del circuito oscilador
deben incluir todas las capacidades distribuidas del circuito.
2.2.3. Clock externo.
Un clock externo proveniente de otro dispositivo compatible con CMOS puede conectarse a la pata OSC1 de acuerdo a
la figura 2.3. En este caso la pata OSC2 queda sin conexin.
Figura 2.3

Figura 2.2

2.3. Reset
Un cero lgico
en la pata RESET, obliga a la
MCU a entrar
en un estado
de
arranque
predeterminado. Ms informacin la tendremos en el
punto 4.1. Resets que publi-

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Artculo de Tapa
Figura 2.4

caremos ms adelante y que ya


est disponible en la web con la
clave dada al comienzo de esta
nota.
2.4. IRQ (External Interrupt
Request).
La patita IRQ es de doble
propsito con las siguientes
funciones:
Para aplicar seales asincrnicos externos de INTERUPT. Refiera al punto 4.2. Interupts (vea la web o aguarde al
prximo nmero).
Para colocar la MCU en
modo de auto revisacin. Refiera al punto 9.1. Circuito de autorevisacin.
2.5. TCMP (Timer Compare).
La caracterstica de comparacin de salidas (output compare) del temporizador de captura y comparacin usa la pata
TCMP como salida. Vea ms
detalles en la seccin 6. Temporizador de captura y comparacin.
2.6. Entrada/salida (I/O)
paralela.
Las 20 patitas I/O de la MCU

forman cuatro ports. Cada pata


I/O es programable como entrada o salida. El contenido del registro de direccin de datos
(DDR) determina la direccin
de los datos de cada port. Escribiendo un valor lgico 1 a
un bit del DDR, activa el buffer
de salida de esta pata; un valor
lgico 0, desactiva el buffer de
salida. Un pulso de RESET inicializa todos los bits de DDR,
implementados a un valor lgico de 0 a conectar estas patas
al modo de entrada.
Nota.
Conecte todas las patas de
entrada o I/O a un nivel lgico
adecuado (por ejemplo a VDD
o VSS). Si bien los ports I/O no
requieren una terminacin para
su funcionamiento correcto, la
terminacin es recomendada
para reducir la posibilidad de
daos por descargas electrostticas.
Un pulso de RESET no inicializa los cuatro registros de
ports de datos. Los registros de
ports de datos A, B, C y D tienen la direccin de $0000,
$0001, $0002 y $0003, respec-

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tivamente. Para evitar niveles


indefinidos, escriba los registros de datos antes de los bits
de DDR (si Ud. no conoce sobre direccionamiento o programacin, tenga en cuenta que
en ediciones anteriores hemos
publicado informacin sobre el
tema y que Ud. puede consultar
en el ndice general que aparece en la web).
Cuando una patita est programada como salida, la lectura
del bit de port asociado realmente lee el valor del cerrojo de
datos de salida y no la tensin
de la pata propiamente dicha.
Cuando una patita est programada como entrada, la lectura del bit del port lee el nivel
de la tensin en la patita I/O. El
cerrojo de datos de salida puede escribirse siempre, independiente del estado del bit DDR.
Los datos de la figura 2.4 indican el circuito tpico del port con
las condiciones particulares siguientes:
(1) Este buffer de salida habilita la salida del cerrojo a excitar la patita cuando el bit de
DDR es 1 (modo de salida).
(2) Este buffer de entrada es
habilitado cuando el bit de DDR
es 0 (modo de entrada).
(3) Este buffer de entrada es
habilitado cuando el bit de DDR
es 1 (modo de salida).
La tabla 2.1 resume las funciones de las patitas I/O.
2.6.1. Port A.
PA7 a PA0 forman un port bidireccional de entrada/salida
para aplicaciones generales de
8 bits. El contenido del registro
A de direcciones de datos
(DDRA) determina si cada una
de las patitas es una entrada o

El Microcontrolador Mas Famoso de Motorola: MC68HC05P9

Figura 2.5

Figura 2.6

salida. En la figura 2.5 vemos el


registro de datos del port A y
DDRA.
DDRA7 a DDRA0 son direcciones de datos del port A.
Estos bits de lectura/escritura determinan si las patitas
PA7 a PA0 son de entrada o salida.
1 indica que el port correspondiente est configurado como de salida.
0 indica que el port correspondiente est configurado como entrada.
2.6.2. Port B y port serial de
entrada/salida (SIOP).

PB7/SCK (clock serial),


PB6/SDI (entrada de datos seriales) y PB5/SDO (salida de
datos seriales), forman un port
I/O de 3 bits con funciones
compartidas. Port B puede funcionar tanto como SIOP como
port I/O de usos generales. La
figura 2.6 muestra el registro de
datos de port B y el registro de
direcciones de datos B (DDRB).
Los bits 4 0 de estos registros
no estn implementados.
Los bits de direcciones de
datos del port B: DDRB7 a
DDRB5 son bits del tipo lectura/escritura y determinan si las
patas PB7 a PB5 son entradas

o salidas.
1 corresponde a
una configuracin
de salida en la pata correspondiente, 0 corresponde a una configuracin de entrada
en la pata correspondiente.
El SIOP es un sistema
amo/esclavo de tres conductores. Cuando el SIOP est activado, SCK funciona como salida de clock en el modo de amo
y de entrada de clock en el modo de esclavo. SDI es la entrada de datos en serie y SDO es
la salida de datos en serie. El
software del usuario puede
anular estos ajustes preestablecidos de DDRB7 a DDRB5 si
fuera necesario.
Una opcin de fbrica permite seleccionar entre un formato
de datos SIOP con el dgito
MSB primero o el dgito LSB
primero.
Use estas mismas patitas
como ports de I/O de uso general cuando el sistema de SIOP
est desactivado. Las patitas
DDRB7 a DDRB5 determinan
la direccin de datos a travs
del port B (entrada o salida).
2.6.3. Port C y conversor
analgico digital.
Port C es un port de 8 bits de
funciones compartidas y comparte cinco de sus patitas con el
conversor analgico digital
(A/D). Cuando el conversor A/D
no est activado, PC7 a PC0
forman un port bidireccional de
8 bits de uso general. El contenido del registro de datos de direcciones C (DDRC) determina
si cada pata es una entrada o
una salida.
Cuando el conversor A/D es
activado, PC7 se transforma en
Saber Electrnica N 170

Artculo de Tapa

Figura 2.7

Figura 2.8

VRH y PC8 a PC3 se transforman en entradas analgicas


AN3 a AN0. El valor de CH1 y
CH0 en el registro de status A/D
y control (ADSCR) selecciona
una de las cuatro patitas como
entrada al conversor A/D.
Cuando el conversor A/D est
activado, una lectura digital del
port C entrega un 0 lgico de
la patita de entrada analgica
seleccionada. Una lectura digital de las patitas restantes del
port C dar sus valores correctos. La tensin VRH es la tensin positiva alta de referencia
para el conversor A/D. VSS es
la tensin de referencia negativa baja del conversor A/D. Un
pulso de RESET apaga el conversor A/D y configura el port C
como port de entrada/salida
(I/O) de uso general. Mayores
datos en la Seccin 8, Conversor Analgico Digital.
La figura 2.7 muestra el registro de datos del port C y

DDRC.
Los bits DDRC7 a DDRC0
corresponden a los bits de direcciones de datos del port C.
Estos bits de lectura/escritura determinan si las patitas PC7
a PC0 son entradas o salidas.
1 corresponde a una configuracin de salida en la pata
correspondiente, 0 corresponde a una configuracin de entrada en la pata correspondiente.
2.6.4.
Port D y
captura del
temporizad
o
r
(TCAP).
PD7/TCAP
y
PD5 forman un
port
de
entrada y
salida de

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dos bits con funciones especiales. La pata PD7/TCAP es usada como lnea de captura de
entrada con deteccin de bordes de pulsos para el temporizador de captura y control y
tambin como entrada digital
de uso general. PD7/TCAP
puede usarse como entrada digital an en el caso de ser usada como patita de entrada de
captura para el temporizador.
No hay ningn driver de salida
asociado con la patita PD7/TCAP. PD5 es una patita de digital de entrada y salida (I/O) de
uso general cuya direccin es
controlada por la pata 5 del registro de direcciones de datos
D (DDRD). La figura 2.8 indica
estos detalles.
El bit de direccin de datos
del port D es DDRD5. Este bit
de lectura/escritura determina
si la patita PD5 funciona como
entrada o salida.
1 corresponde a una configuracin de PD5 como salida.
0 corresponde a una configuracin de PD5 como entrada.
En las siguientes entregas
de esta serie sobre los microprocesadores de Motorola proseguiremos con el anlisis del
procesador MC68HC05P9.

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